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1)  silicon piezoresitive chip
硅压阻芯片
2)  Silicon chip
硅芯片
1.
The structure and realization of the new dual-E silicon chip is introduced.
通过控制不同的敏感硅芯片弹性膜的 厚度,即可制得不同量程的双E型敏感硅芯片和加速度传感器。
2.
The new silicon chip of dual-E detailed introduction of the structure and the realization of the technology is reported.
介绍了最新优化设计的双 E型加速度传感器硅芯片结构和工艺的实现。
3)  solid piezoresistive silicon flat chip
固态压阻平膜芯片
1.
The micro electro-mechanical system(MEMS) and integrated circuit technology were adopted to manufacture the solid piezoresistive silicon flat chip with high precision and sensitivity,and packaged on the concentrated stress location of an elastic beam by glass powder sintering,and the special piezoresistive acceleration sensor was developed with th.
采用微型机械电子系统技术和集成电路工艺制作出了高精度、高灵敏度的硅微固态压阻平膜芯片,通过玻璃粉烧结工艺将其键合在弹性梁的应力集中处,利用激光焊接工艺,制造了量程为±20 km/s2、过载能力为30倍满量程的特种压阻式加速度传感器。
4)  silicon chip area
硅芯片面积
5)  compress chip
压缩芯片
1.
Introduced high-performance speech compress chip-AMBE-2000 TM s characteristic and application which was exploited by Digital Voice Systems, Inc and particularly expatiates its communicational format and applicatio
介绍了 Digital Voice Systems,Inc开发的高效语音压缩芯片 AMBE- 2 0 0 0 TM的特点及其应用 ,详细阐述了 AMBE- 2 0 0 0 TM的通信格式及其应
6)  chip resistor
芯片电阻器
补充资料:半导体的压阻效应
      指应力作用下半导体电阻率的变化。在一些半导体中有相当大的压阻效应,这与半导体的电子能带结构有关。
  
  压阻效应是各向异性的,要用压阻张量π(四阶张量)来描述,它与电阻率变量张量δ ρ(二价张量)和应力张量k(二阶张量)有如下关系:π:k。由于对称二阶张量只有六个独立分量, 故亦可表达成这样,压阻张量可用6×6个的分量来表达。根据晶体对称性,像锗、硅及绝大多数其他立方晶系的半导体,压阻张量只有三个不等于零的分量,即π11、π12和π44
  
  测量压阻效应,通常有两类简单加应力的方法:①流体静压强效应。这时不改变晶体对称性,并可加很大的压强。锗、硅的电阻率都随压强增大而变大。②切应力效应。利用单轴拉伸或压缩,这时会改变晶体对称性。压阻系数Δ ρ/ ρk,与外力方向、电流方向及晶体结构有关。对锗、硅,压阻系数如下表所示:
  
  20世纪50年代起,压阻效应测量曾作为研究半导体能带结构和电子散射过程的一种实验手段,对阐明锗、硅等主要半导体的能带结构起过作用。锗和硅的导带底位置不同,故其压阻张量的分量大小情况也不同。N型锗的π44比π11、π12大得多,而N型硅的π11却比π12、π44大。这表明锗导带底在<111>方向上,硅导带底在<100>方向上。对于P型半导体,也有过一些工作。利用压阻测量和别的实验(例如回旋共振等),取得一系列结果,对锗、硅等的能带结构的认识具体化了。
  
  现在,半导体的压阻效应已经应用到工程技术中,采用集成电路工艺制造的硅压阻元件(或称压敏元件),可把力信号转化为电信号,其体积小、精度高、反应快、便于传输。
  

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