1) control-line passage
控制管线通道
2) channel bus controller
通道总线控制器
3) control channel
控制通道
1.
In this paper, we first introduce the four procedures of LMP: control channel management ,link property correlation, link connectivity verification and fault management.
介绍了LMP的主要功能:控制通道管理、链路属性关联、链路连通性验证和故障管理,并对LMP控制通道管理做了进一步的分析和研究。
2.
From the principle of function angle, it introduced the main control channel and functions of the naval ship integrated command and control system in details.
并从功能原理的角度较为详细的介绍了舰艇集成指控系统的主要控制通道及其功能。
4) corridor control
通道控制
1.
Traffic corridor control model of urban road;
城市道路中的通道控制模型
2.
This paper points out that the integrated problem of entrance on ramp control, mainline control and corridor control must be studied in order to solve traffic jam of freeway effectively.
本文指出要有效解决高速公路的交通拥挤与堵塞问题 ,必须研究入口匝道控制、主线控制、通道控制等的集成问题 。
5) channel control
通道控制
1.
Owing to the difference in channel control method and handshaking process of position machine and MCU, single serial interface is designed respectively for master-slave dual-MCU system and parallel dual-MCU system.
根据通道控制方式及上位机与MCU握手过程的不同,分别给出主从式双MCU系统单串行接口和并列式双MCU系统单串行接口两种实现方式。
2.
This method is effective in reducing the sensor\'s recovery time for fast channel control.
这种方法有效地缩短了传感器的恢复时间,为快速的通道控制提供了可能。
6) ONT management and control protocol (OMCP)
ONT管理和控制通道
补充资料：总线控制器
总线控制器
bus controller
信号，并用这些信号对存储器和输人输出系统的地址锁存、数据收发、允许写和允许输出等进行控制。控制翰人信号控制箱出状态箱人 ┌───┐ │状态机│ └───┘┌──┐ │状态│ │解码│ └──┘ 命令拾出 图1总线控制器电路结构 使用总线控制器的数据允许1〕EN和数据收发Efl丫R信号控制数据总线收发器;其中，用DEN启动数据收发器，用D】丫豆控制数据收发器的方向。利用对DEN和I〕T/R的定时控制，可以避免总线主控设备、数据总线收发器等的总线争用。 利用允许地址锁存ALE的输出确定对地址锁存的时间。从前一个总线操作完成到下一个总线操作出现在锁存器输出端为止，ALE至少要提供一个系统地址保持时间。利用该保持时间，支持多总线和公用存储系统。另外，系统命令的延迟也受到总线控制器的控制。命令延迟信号允许增加地址或写数据的时间，以便系统总线命令借助延迟完成各种总线操作。 使用总线控制器，是为了解决CPU控制负载过重与外引线数目受限制等问题。它使CPU仅产生状态信号，不直接产生控制存储器或1/0电路的读写信号。在构成系统时，就需要总线控制器译码状态信息，从而产生能直接控制驱动存储器和1/0读写的信号。由于总线控制器需要较高的负载能力，因此，一般采用双极型电路。 典型的总线控制器产品为82 C 288，它采用高速CHM()S技术。其主要功能有:提供局部总线和系统总线命令和控制，单+SV电压，全静态器件，与HM(万技术的82288全兼容。zongxian kongzh.qi总线控制器(bus controller)计算机系统中用以代替中央处理器(CPtl)，提供总线控制和命令信号的一种专用集成电路。一般情况下，CPU输出表征该总线周期要存取的设备的状态信号，通过总线控制器产生该总线周期所需的全部总线控制信号及命令输出信号，并对连在总线上的存储器和输人输出(I/O)设备进行控制。总线控制器也称系晚总伐挂润霖。 总线控制器的内部结构主要由状态解码、控制输人逻辑、状态机、控制输出逻辑和命令输出逻辑等组成，其电路结构如图1所示。控制输出提供允许地址锁存ALE、数据收发1〕1，/R、数据允许DEN等
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参考词条